조정이 필요 없는 주파수 더블러. 계획, 설명

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디지털 시스템에서 자주 사용되는 주파수 더블러의 단점은 각각의 특정 주파수를 튜닝해야 한다는 것입니다. N에 의한 분배기에 사용하도록 설계된 제안된 회로는 0에서 수 메가헤르츠 범위의 조정이 필요하지 않습니다.

신호가 회로를 통과할 때 펄스 반전 외에도 각 인버터는 약간의 지연(일반적으로 20ns)을 발생시킵니다. 따라서 예를 들어, 입력 신호가 지점 L에서 반전된 후 지점 D의 신호가 60ns 반전되므로 지점 A의 입력 신호를 로우에서 로우로 전환한 후 6ns 동안 게이트 60의 두 입력에서 높은 전위가 유지됩니다. 높은. 이 경우 밸브 6(점 F)의 출력 전압은 회로 입력에서 양의 강하가 도달한 후 60ns가 감소합니다. 거의 유사한 프로세스가 밸브 5에서 발생합니다. 유일한 차이점은 음의 입력 에지가 도달한 후 60ns 동안 출력에서 낮은 전위가 형성된다는 것입니다. 그림에 표시된 회로에서 인버터 1, 2 및 3은 F 및 G 지점에서 음의 60ns 펄스를 생성하는 이중 기능을 수행합니다. 이 회로 설계를 통해 게이트 수를 줄일 수 있습니다.

조정이 필요 없는 주파수 더블러

밸브 5 및 6의 출력 펄스는 밸브 7'의 입력으로 공급되며, 밸브는 입력에서 전위가 감소할 때 60ns의 양의 펄스를 생성합니다. 한 입력에서 전위의 감소는 지점 A에서 각 입력 펄스의 상승 에지와 일치하고 다른 입력에서의 전위 감소는 후행 에지와 일치하므로 지점 H에서 출력 펄스의 주파수는 점 A에 입력

저자: N. McGahee; 간행물: N. Bolshakov, rf.atnn.ru

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