간단한 동기 주파수 배율기. 계획, 설명

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간단한 동기식 주파수 체배기. 무선 전자 및 전기 공학 백과사전

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디지털 기술을 좋아하는 라디오 아마추어에게는 펄스 신호의 주파수를 나누는 것이 어렵지 않습니다. 그러나 입력에 대해 동기화된 출력 신호의 주파수를 곱해야 하는 경우 설계자는 심각한 어려움에 직면하게 됩니다. 일반적으로 공진 회로, 입력 신호의 고조파가 이러한 목적으로 사용됩니다. 따라서 [1]에서 설명한 주파수 체배기는 상대적으로 단순하지만 입력 펄스 주기 내에서 자동 생성기에 의해 생성된 고주파수 출력 신호의 선택만 제공합니다.

가변 곱셈 계수와 입력 신호에 대한 출력 신호의 긴밀한 동기화가있는 간단한 주파수 체배기의 다이어그램이 그림 1에 나와 있습니다. 1.1. 1.3개의 인버터 DD1-DD2에 있는 펄스 발생기와 트랜지스터 VTXNUMX에 있는 동기화 단계로 구성되며 [XNUMX]에 설명된 장치와 회로가 가깝습니다.

단순 동기 주파수 승수

입력 클럭 펄스가 없으면 DD1.1-DD1.3의 멀티바이브레이터가 정상적으로 작동합니다. 입력에 두 개의 보호 다이오드가 있는 마이크로 회로가 발전기에 사용되는 경우 모든 극성에 대한 커패시터 C1의 재충전 시간은 동일하고 펄스 주기는 1,4 R3∙C1이고 주파수 f는 0,7/(R3∙ C1).

주파수 Fin의 양의 펄스가 입력 VT1에 도달하면 (그림 2) 트랜지스터가 순간 t1, t3에서 열리고 주기적 재충전 프로세스가 중단됩니다. t2, t4 순간부터 닫은 후 생성 프로세스를 재개합니다. 생성기는 주파수 Fout = kFin을 사용하여 입력 펄스와 동기식 펄스를 생성합니다. 여기서 k는 요소 R3, C1에 의해 결정되는 가변 곱셈 계수이고 Fin은 입력 펄스의 주파수입니다.

단순 동기 주파수 승수

DD1의 요소로 K176, K561, KR1561 시리즈의 마이크로 회로 인버터를 사용할 수 있습니다. 또한 요소 DD1.1, DD1.2는 반전(버퍼)이 없거나 히스테리시스(슈미트 트리거)가 있을 수 있으며 KT315 시리즈 트랜지스터를 다른 유사한 트랜지스터로 교체할 수 있습니다.

이 장치는 텔레비전 스캔의 수평 주파수 펄스 입력에 적용할 때 정보의 형성 또는 읽기를 위해 래스터 라인의 엄격하게 정의된 섹션을 선택할 수 있습니다.

문학

주파수 승수. "해외" - 라디오, 1997, 9번, p. 47.
Bannikov V. 디지털 주파수 배율기. - 라디오, 1999, 1번, p. 49.

저자: I.Zabelin, 모스크바

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