주파수 합성기 TSA6060. 참조 데이터

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주파수 합성기 TSA6060. 참조 데이터

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Philips Semiconductors는 무선 통신 시스템에서 직간접적으로 사용되는 주파수 합성기, 무선 송신기 칩, 수신기 및 기타 구성 요소의 선두 제조업체입니다. Philips Semiconductors 주파수 합성기는 자동차 경보용 무선 채널 모듈, 원격 사이트에서 정보를 수집 및 처리하는 시스템, 보안 및 액세스 제어 시스템, 무선 전화 시스템을 구축하는 데 사용됩니다.

Philips Semiconductors의 TSA6060 칩[1]은 AM 및 FM 대역에서 작동하는 PLL(위상 고정 루프)이 있는 디지털 합성기를 구축하도록 설계되었습니다. 여기에는 전압 제어 발진기(VCO) 및 저주파 필터(LPF)를 제외하고 PLL로 주파수 합성기를 구축하는 데 필요한 모든 요소가 포함됩니다. 마이크로 회로에는 발생기 및 기준 주파수 분배기, 프로그래밍 가능한 분할 계수(17비트)가 있는 입력 주파수 분배기, 디지털 위상 검출기, XNUMX레벨 전류 증폭기 및 I 프로토콜을 사용하여 마이크로컨트롤러와 통신하기 위한 컨트롤러가 포함됩니다.²C. 장치의 블록 다이어그램은 그림 1에 나와 있습니다. 1. 표 2은 주요 기술적 특성인 표 16의 마이크로 회로 핀의 번호, 지정 및 할당을 보여줍니다. 초소형 회로는 DIP16 및 SO2 패키지로 제공되며 핀 배치는 그림 XNUMX에 나와 있습니다. XNUMX.

정보는 마이크로 회로에 기록됩니다 (프로그래밍)는 SDA 및 SCL의 두 라인을 따라 수행됩니다. 버스 I²다[2]. 3개의 주소와 XNUMX개의 구성 바이트가 프로그래밍에 사용됩니다. 주소 바이트(AB 바이트)에는 장치 주소와 AS 비트가 포함됩니다(표 XNUMX). 이 비트가 해당 마이크로 회로 출력의 논리 레벨과 일치하면 구성 정보가 기록됩니다. 나는 하나에게²서로 독립적인 두 개의 신디사이저를 C-버스에 연결할 수 있으며 AS 비트를 사용하여 프로그래밍할 신디사이저를 선택할 수 있습니다. 주소 바이트는 프로그래밍되지 않고 제조업체에서 생산하는 동안 정보가 입력되며 AS 비트의 내용은 미세 회로의 핀 12에서의 전위에 의해 결정됩니다.

정보의 일부만 업데이트해야 하는 경우(예: DBO+DB1) TSA6060을 부분적으로 프로그래밍할 수 있습니다. 어떤 경우에도 전송은 "중지 조건"에 의해 종료되어야 합니다. 무화과에. 3은 마이크로컨트롤러에서 주파수 합성기로 정보가 전송되는 순서를 보여줍니다. 구성 바이트의 비트 할당은 다음과 같습니다(표 4).

R1, R2는 주파수 그리드 단계를 설정합니다(표 5).
X는 회로의 작동 모드를 결정합니다("0" - AM 대역, "1" - FM 대역).
Y는 출력 키를 제어합니다("0" - FM/AM 키가 열림, AM/FM 키가 닫힘, "1" - 그 반대).
Z는 사용된 수정 공진기의 주파수를 설정합니다.
BS는 동일한 이름의 마이크로 회로 출력 모드를 제어합니다(이 출력은 개방형 컬렉터임). BS="0"이면 출력이 높은 임피던스 상태로 전환되고 BS="1"이면 전류 흡수 모드로 전환됩니다. ;
Т1, Т2, ТЗ는 회로 테스트 모드를 결정합니다(표 6).

Z="0"일 때 미세 회로는 4MHz, Z="1"(8MHz)에서 석영 공진기와 함께 작동해야 합니다. AM 대역(X="0")에 대한 입력 주파수 분할 계수는 S2-2입니다.⁰ + S3-2¹ + S4-2²+ ... + + S15-2¹³ + S16-2¹⁴, 그리고 FM 대역의 경우(X="1") SO-2⁰ + S1-2¹ + S2-2² + ... + + S15-2¹⁵ + S16-2¹⁶.

또한 AM의 경우 최소 분할 계수는 2입니다.⁶=64, FM용 - 2⁸= 256.

CP 비트(Current Amplifier Control Bit)가 "1"로 설정되면 증폭기는 약 500µA의 전류를 출력하여 빠른 튜닝 속도를 제공합니다. 그렇지 않으면(CP="0"일 때) 전류는 25μA이므로 더 높은 조정 정확도를 제공합니다.

PLL 합성기의 블록 다이어그램은 Fig. 4, 일반적인 스위칭 회로 - 그림에서. 5. 신디사이저에서 위상 검출기를 사용하여 기준 주파수의 위상을 VCO 주파수를 분할한 결과로 얻은 프로그래머블 분배기의 출력 주파수와 비교합니다. PLL이 "캡처" 모드에 있을 때, 즉 위상 검출기 입력의 위상차가 제한 값보다 작을 때 전류 증폭기의 출력은 하이 임피던스 상태가 되고, 루프 캡처 감지기(INLCK)는 논리 "1"입니다. 루프가 "캡처" 모드를 벗어나면, 즉 위상 검출기가 입력 신호 간의 위상차를 감지하면 전류 증폭기가 루프 필터(LPF)에 대한 보정 펄스를 생성합니다. FM 대역의 경우 필터는 C5-C10-R7 요소, AM의 경우 C6-C9-R6 요소에 만들어집니다. 펄스 지속 시간은 위상차에 비례합니다. 위상 검출기에 도착하는 신호 중 어느 신호가 다른 신호보다 앞서 있는지에 따라 전류 증폭기의 출력이 흡수 모드 또는 전류 소스 모드로 전환되어 루프 필터의 커패시터를 필요한 전압으로 충전 또는 방전합니다. PLL 루프를 캡처 모드로 전환합니다. . 위상 일치 모드 외부에서 INLCK 출력은 논리 "0"입니다.
쌀. 도 6은 주파수 제어 프로세스의 시퀀스를 도시한다. 위쪽 그래프에서 오실레이터 주파수는 수직축을 따라 표시됩니다. f1 - VCO 주파수, f2 - 예시적인 오실레이터의 안정적인 주파수. 회로를 켠 후 먼저 프로그래밍됩니다. 그런 다음 VCO의 주파수가 증가하기 시작합니다. f2와 fl 사이의 위상 차이가 제한 값보다 작으면(간격 t1-t2, t3-t4 및 t > 15) 내부 플래그가 "0"이 되어 회로가 캡처 모드에 있음을 나타냅니다. 주파수 f1이 약간 증가하면 조정 프로세스가 시작되고 내부 플래그가 "1"로 변경되고 f1이 캡처 범위(간격 t2-t3)로 돌아갑니다. f1이 감소하면 모든 것이 동일합니다(간격 t4-t5). f1이 캡처 모드에 있음을 나타내는 INLCK 출력의 로직 "1"은 f8의 2 진동 주기와 동일한 지연으로 나타납니다. 이는 짧은 캡처 기간 t1-t1 및 t2-t3 동안 INLCK 출력에서 논리 "4"이 없음을 설명합니다.

표 1

1	WLCK	PLL 루프 캡처 감지기 출력
2	XTAL	석영 공진기 연결용 입력(4 또는 8MHz)
3	Vcc1	첫 번째 전원 공급 장치 연결용 입력(신디사이저의 디지털 부분에 전원 공급용)
4	비	토지
5	FMi	FM VCO 연결을 위한 주파수 입력
6	12월	프리스케일러 분리
7	AMI	AM VCO 연결을 위한 주파수 입력
8	BS	범위 제어 출력
9	Frefu	주파수 출력 40kHz
10	SDA	직렬 데이터 입력 I²버스에서
11	SCL	동기화 입력 I²C 타이어
12	AS	칩 선택 입력
13	FMO	외부 필터 연결을 위한 FM 출력
14	루피	출력 전압 증폭기 설정을 위한 입력
15	모어	외부 필터 연결을 위한 AM 출력
16	Vcc2	두 번째 전원 공급 장치 연결용 입력(신디사이저의 아날로그 부분에 전원 공급용)

표 2

정격 공급 전압 Vcc1, V	4,5 ... 5,5
정격 공급 전압 Vcc2, V	(Vcc1+1)...12
소비 전류 Icc1, mA, 더 이상	15
소비 전류 Icc2, mA, 더 이상	1,5
입력 주파수 AMi, MHz	0,5 ... 30
입력 주파수 FMi, MHz	30 ... 200
그리드 단계 Fobr, kHz	1; 10; 25; 50
입력 전압 AMi, mV	30 ... 500
입력 전압 FMi, mV	20 ... 300

주파수 합성기 TSA6060. 참조 데이터. 장치의 구조도
쌀. 1. 장치의 블록 다이어그램

주파수 합성기 TSA6060. 참조 데이터. 회로 핀아웃
쌀. 2. 마이크로 회로의 핀아웃

표 3

비트 번호	7	6	5	4	3	2	1	0
비트 콘텐츠	1	1	0	0	0	1	AS	0

주파수 합성기 TSA6060. 참조 데이터. 마이크로컨트롤러에서 주파수 합성기로 정보를 전송하는 순서
쌀. 3. 마이크로컨트롤러에서 주파수 합성기로 정보를 전송하는 순서

표 4

비트 번호	7	6	5	4	3	2	1	0
이사회	S6	S5	S4	S3	S2	S1	S0	CP
DB1	S14	S13	S12	S11	S10	S9	S3	S7
DB2	R1	R2	X	Y	Z	BS	S16	S15
안녕	-	-	-	-	Т3	Т2	Т1	-

표 5

R1	R2	단계 모범적 인 주파수, kHz
0	0	1
0	1	10
1	0	25
1	1	50

표 6

Т3	Т2	Т1	기능
1	0	1	전류 소스 모드의 전류 증폭기
0	1	1	전류 흡수 모드의 전류 증폭기
1	1	1	세 번째 상태 전류 증폭기 출력
0	0	1	흡수 모드 및 전류 소스의 전류 증폭기
1	1	-	출력 BS - 분배기의 주파수
1	0	-	BS 출력 - 기준 주파수

주파수 합성기 TSA6060. 참조 데이터. PLL 합성기 블록 다이어그램
쌀. 4. PLL 합성기의 블록 다이어그램

주파수 합성기 TSA6060. 참조 데이터. 일반적인 배선도 TSA6060
쌀. 5. 일반적인 스위칭 회로

주파수 합성기 TSA6060. 참조 데이터. 주파수 제어 과정의 순서
쌀. 6. 주파수 제어 과정의 순서

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