주파수 합성기용 LM7001 시리즈의 마이크로 회로. 참조 데이터

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주파수 합성기용 LM7001 시리즈의 마이크로 회로. 참조 데이터

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칩 LM7001J 및 LM7001JM은 가정용 라디오 수신기에 사용되는 PLL 시스템으로 주파수 합성기를 구축하도록 설계되었습니다. 두 미세 회로는 회로와 매개변수가 동일하고 케이스 설계만 다릅니다. LM7001J에는 기존 장착용 DIP16 케이스가 있고 LM7001JM에는 표면 장착용 MFP20 케이스(둘 다 플라스틱)가 있습니다. 하우징 도면은 Fig. 1a 및 b.

주파수 합성기용 LM7001 시리즈 칩

미세 회로의 핀아웃은 표에 나와 있습니다. 하나.

주파수 합성기용 LM7001 시리즈 칩

결론 Xout 및 Xin - 예시적인 주파수의 신호 증폭기의 출력 및 입력; 석영 공진기가 이러한 결론에 연결됩니다. CE 쓰기 활성화 신호 입력 CL - 쓰기 클럭 입력. 데이터 - 정보 입력 SC - 싱크로 제어 - 제어 주파수 신호 출력 400kHz. BSout1 - BSout3 - 대역 전환 - 외부 장치 제어용 출력(출력 BSout1, 추가 - 주파수 8Hz의 신호 출력) 이 신호는 범위를 전환하는 데 사용됩니다. AMin 및 FMin은 프로그래밍 가능한 주파수 분배기의 입력, 즉 AM 및 FM 신호의 입력입니다. Pd1 및 Pd2 - 각각 FM 및 AM 모드에서 주파수 위상 검출기의 출력.

장치의 기능 다이어그램은 그림 2에 나와 있습니다.

주파수 합성기용 LM7001 시리즈 칩

수신 시프트 레지스터에 도착하는 비트의 제어 시퀀스는 합성기의 주파수 그리드 단계 값, 프로그래밍 가능한 주파수 분할기의 분할 계수, 작동 모드 및 출력 BSout1 - VSoul3의 상태를 결정합니다.

전압 제어 발진기(VCO)의 출력 신호는 입력(AMin 또는 FMin) 중 하나에 공급됩니다. 스퓨리어스 노이즈를 방지하기 위해 사용하지 않는 입력은 차단됩니다. 주파수 분배기는 예시적인 생성기의 신호 주파수와 입력 신호를 필요한 횟수만큼 그리드의 주파수 단계 값까지 줄입니다. 위상 검출기는 두 신호를 비교하고 신호 사이의 위상차에 비례하는 레벨의 오류 신호를 생성합니다. 마이크로 회로의 선택된 작동 모드에 따라 출력 Pd1 및 Pd2에서 오류 신호가 제거됩니다.

주요 기술 특성

정격 공급 전압, V.....4,5...6,5
CE, CL, Data.....2,2...6,5 입력의 하이 레벨 입력 전압, V
입력 전압 로우 레벨, V, 입력 CE, CL, 데이터.....0...0.7
출력 SC, V ..... 6,5에 공급되는 최대 허용 전압
입력 BSout1 - BSout3, V.....13에 공급되는 최대 허용 전압
SC 출력의 최대 허용 출력 전류, mA.....3
입력 BSout1 - BSout3, mA.....3의 최대 허용 입력 전류
입력 주파수 간격 AMin, MHz.....0.5...10
입력 주파수 간격 FMin, MHz, 주파수 그리드 단계 25, 50, 100 kHz.....45...13
1, 5, 9, 10kHz.....5...30
입력 AMin 및 FMin, V(rms).....0.1...1,5에서의 감도
입력 AMin 및 FMin, kOhm ..... 500에서 입력 저항의 일반적인 값
총 전류 소비, mA.....40

마이크로 회로는 1, 5, 9, 10, 25, 50 또는 100kHz(기준 발진기 주파수 7200kHz)의 3가지 표준 주파수 그리드 단계 값으로 작동할 수 있습니다. 비트의 제어 시퀀스와 주요 타이밍 매개 변수는 그림 XNUMX에 나와 있습니다. 삼.

주파수 합성기용 LM7001 시리즈 칩

AM 및 FM의 두 가지 모드에서 작동할 수 있는 프로그래머블 디바이더의 주파수 분할 요소의 최하위 비트부터 시작하여 정보의 도입이 순차적으로 발생합니다.

FM 모드에서 프로그래밍 가능한 주파수 분배기는 DO-D13 비트를 사용합니다. 나누기 계수의 최대값은 3FFF(16383진수) 또는 XNUMX 십진수입니다.

AM 모드에서는 D4-D13 비트가 사용됩니다. 최대 분할 계수 값은 3FF 또는 1023입니다.

비트 T0 및 T1은 테스트 비트이며 항상 낮게 설정해야 합니다. 비트 B0-B2 및 TV는 출력 BSout1 - BSout3의 상태를 제어합니다. 비트와 출력의 상태 사이의 대응 관계는 표에 나와 있습니다. 2.

주파수 합성기용 LM7001 시리즈 칩

비트 R0-R2에는 합성기의 주파수 그리드 단계에 대한 정보와 출력 BS0Ut2-BS0Ut1의 상태에 대한 정보(제어 비트 B0-B3가 3으로 설정된 경우)가 포함됩니다. 수준 분포는 표에 요약되어 있습니다. 삼.

주파수 합성기용 LM7001 시리즈 칩

비트 S는 프로그래밍 가능한 주파수 분배기의 작동 모드를 결정합니다(1 FM, 0 - AM).

컨트롤 시퀀스를 컴파일하는 예를 살펴보겠습니다. 신디사이저가 중간 주파수가 10,7MHz인 VHF 라디오 수신기에 사용되어 반송파 주파수가 100MHz인 신호를 수신한다고 가정합니다. 주파수 그리드 단계는 50kHz입니다.

필요한 주파수 분할 계수를 찾으십시오. 로컬 오실레이터가 수신된 주파수보다 낮은 주파수에서 작동하는 경우 주파수는 100 - 10,7 - 89,3MHz입니다. 분할 계수

Kdel = 89300:50 = 1786 = 6FA(0110진수) = 1111 1010 XNUMX(빈).

XNUMX진수를 XNUMX진수 XNUMX진수로 또는 그 반대로 변환하려면 Windows 운영 체제의 표준 프로그램에 포함된 소프트웨어 계산기를 사용하는 것이 편리합니다.

외부 장치 제어를 사용하지 않는 경우 마이크로 회로의 비트 시퀀스는 표에 표시된 형식을 취합니다. 4.

(확대하려면 클릭하십시오)

주파수 1000kHz(중간 주파수 465kHz)의 MW 라디오 수신기에서 합성기를 사용하는 경우 그리드 단계는 5kHz입니다. 국부 발진기가 신호 주파수보다 큰 주파수에서 작동하는 경우 - 1000 + 465 = 1465kHz. 저것

Kdel = 1465:5 = 293 = 125(0001진수) = 0010 0101 XNUMX(빈).

이 경우의 제어 순서는 <표 5>와 같다.

(확대하려면 클릭하십시오)

일반적인 미세 회로 스위칭 회로의 옵션 중 하나가 그림 4에 나와 있습니다. 6. 전원 회로의 간섭을 줄이기 위해 양극 및 음극 전원 리드 사이에 차단 커패시터(C3)를 포함해야 합니다. 이 커패시터를 칩에 최대한 가깝게 납땜하십시오. VCO 출력과 마이크로 회로 사이의 전환 커패시터 C7 및 CXNUMX도 케이스 근처에 장착해야 합니다.

주파수 합성기용 LM7001 시리즈 칩

주파수-위상 검출기의 각 출력과 VCO의 제어 입력 사이에는 일반적으로 능동 반전 저역 통과 필터가 포함됩니다(점선으로 다이어그램에서 원으로 표시됨). 필터 요소의 값은 필요한 컷오프 주파수와 VCO의 기울기에 따라 선택됩니다. 필터는 조심스럽게 차폐되어야 합니다.

다이어그램의 요소 등급은 근사치입니다. 해당 값은 특정 그리드 간격, 필요한 저역 통과 필터 이득, VCO 튜닝 슬로프 등에 따라 최적화되어야 합니다.

저자: A. Temerev, Svetlovodsk, Kirovograd 지역, 우크라이나

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